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【FPGA開發日記——調整時序】記錄調整時序過程中遇到的問題與解決方式
2020-12-30
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`include在Verilog中的應用
2020-12-30
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在利用Verilog寫狀態機過程中遇到的一些小問題的總結
2020-12-30
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狀態機
基於FPGA的簡易頻率計設計
2020-12-30
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基於FPAG的簡易數字頻率計設計
2020-12-30
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Verilog上機實驗題目1：8位數字顯示的簡易頻率計
2020-12-30
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CIC濾波器和FPGA實現
2020-12-30
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CIC
FPGA學習嵌入式硬件最小系統搭建（一）（NIOS II處理器設置）
2020-12-30
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經驗分享
FPGA學習嵌入式硬件最小系統搭建（二）（RAM，system_id及PIO等）
2020-12-30
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經驗分享
AXI Stream 轉AXI4 DMA IP設計
2020-12-30
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axi4
Apache
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每日一句
每一个你不满意的现在，都有一个你没有努力的曾经。
