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Verilog實現減法器
時間 2021-01-08
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1)半減器 半減器只考慮當前兩位二進制數相減,輸出爲差以及是否向高位借位。其真值表如下: 得出其邏輯關係式: d = x^y ; // ^異或運算 cin = ~x&y ; Verilog 代碼段: 仿真波形: 2)全減器 而全減器還要考慮當前位的低位是否曾有借位,其真值表如下: 得到其邏輯關係式: d = x ^ y ^ cout ; cin = (~x&(y^cout))|(y&cout) ;
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