Xilinx IP核使用(一)--FIFO

時間 2020-01-21

標籤 xilinx 使用 fifo 简体版

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今天在將SRIO的數據存入FIFO後，而後把FIFO中的數據不斷送入FFT進行運算時，對於幾個控制信號總產生問題。因此單獨對FIFO進行了仿真。原來感受FIFO的幾個參數端口一目瞭然啊，還須要什麼深刻了解嗎，在實驗發生問題才知道當時的想法多麼幼稚啊。異步下面對xilixn FIFO核進行下簡單說明，配上仿真時序圖和源代碼，描述的仍是比較清晰的。但願對和我同樣剛接觸FPGA不久的同

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