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FPGA靜態時序分析基本概念
時間 2020-12-30
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1.1延遲因素 第一,FPGA芯片內部的一些固有延遲,包括建立時間Tsu、保持時間Th和數據存入寄存器到輸出管腳時間Tco,這些時間是由FPGA芯片決定的,不同的FPGA芯片這些延遲時間不一樣。(如圖1) 第二,路徑延遲,包括時鐘路徑延遲和數據路徑延遲,這兩種延遲都與設計的邏輯有關,而最主要的延遲還是數據延遲,所以好的代碼設計非常重要。(如圖1) 圖一 FPGA芯片內部 第三、外部
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