21.FPGA之PLL鎖相環使用
1.添加ip核異步 tools-megaWizardide 工程規範，存放在ipcore文件夾下post 設置參數：設計 a,速度等級3d 如下三行分別表明：code 是否添加異步復位component 是否添加locked信號，當locked從低電平到高電平時表示鎖相環穩定blog 是否在時鐘自鎖的時候自動復位ip 配置第一路輸出時鐘資源 頻率，相位，佔空比 qip是quartus I
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