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基於Xilinx PYNQ-Z2 Verilog任意模值帶置位可逆加減計數器(六位數碼管顯示)
時間 2021-01-03
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FPGA
Verilog
計數器
數碼管
vivado
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本系統爲有置數端的任意模長可調加減計數器,由 分頻電路模塊、加減可切換計數器模 塊、按鍵消抖模塊、譯碼顯示電路模塊和校時電路模塊五大部分構成,其主要功能是計數, 通過 1s 計數時鐘也可用作簡易定時器、秒錶等。該計數器還通過顯示譯碼電路將計數器的狀態 、模值以及計 數器數值直觀的在 6 位 7 段共陰極數碼管上顯示出來,左邊兩位顯示計數器數值,中間兩位 「Ad」表示當前爲加法器狀態,「FE」表示當
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