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Verilog 6位數碼管LG3661BH 的動態顯示
時間 2021-01-03
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module smg(clk,Rst_n,dig,sel,led); input clk; //50m晶振 input Rst_n; //復位鍵 output reg [7:0] dig; //數碼管abcdefgh output reg [5:0] sel; //6位數碼管位選 reg [23:0]data;//要顯示的數 reg [3:0] num=0; [emai
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