SDRAM時序分析-基於signalTapII
SDRAM時序分析-基於signalTapII 背景：利用FPGA驅動SDRAM，本篇是時序仿真部分，理論理解詳見上傳文件； 修改部分： 1、刷新週期：改爲64ms/(2^13)=7.8125us 2、讀命令的啓動條件：sdram初始化完成後啓動 3、SDRAM讀出的數據寫入到FIFO中的寫入請求信號提前一個時鐘使能； 4、初始化階段的預充電指令指令對所有bank充電，即此時的A[10]改爲1；
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