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Xilinx FIFO Generate 需要注意Actual Depth
時間 2021-05-04
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FPGA設計從硬件到軟件
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FIFO深度
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Xilinx FIFO Generate 需要注意Actual Depth 又是沒有仔細看手冊掉入的坑,提醒一定注意例化FIFO的時候,注意FIFO的實際深度Actual Depth; 這麼個現象 平時使用FIFO的時候,很少有使用到FULL的狀態;而且由於開發板資源足夠,所有的FIFO也都是留有一部分(至少30%)的冗餘; 某次使用FIFO的時候 ,發現256的深度,老是計數記不到256,仿真中
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