FPGA學習：MODESIM與FPGA原理圖聯合仿真
在QUARTUS中編譯能夠成功，Modelsim仿真時出現如下錯誤 ：「erro: Instantiation of '***' failed. The design unit was not found"。原因：在Modelsim中只能新建HDL類的文件，而不能採用原理圖輸入的方式，即Modelsim不能識別」原理圖輸入「方式。 解決方法：首先，將原理圖文件怎麼變成HDL文件，FILE->New
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