Josh 的學習筆記之 Verilog （Part 1——初識 HDL 設計方法）
文章目錄 1. 設計方法的變遷 2. Verilog 語言的特點 2.1 Verilog 的由來 2.2 Verilog 和 VHDL 2.3 Verilog 和 C 3. HDL 的設計與驗證流程 3.1 系統與功能模塊定義（系統與功能模塊級） 3.2 行爲級描述測試激勵（Behavioral Level） 3.3 寄存器傳輸級(RTL, Register Transfer Level) 3.4
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