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IC設計高級006:流控反壓機制導致的路徑延時
時間 2021-07-13
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IC設計
流水反壓設計
路徑延時
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1、流水反壓機制 在之前的文章中,我們介紹了FIFO閾值如何設置。其實FIFO的閾值設置就是流水反壓機制的一種。當下遊模塊存儲的數據量超過將滿水線時,下游模塊會通過一根流控信號線fc通知上游模塊停止發送模塊,當下遊模塊存儲的數據量低於將滿水線時,流控信號線fc爲無效狀態,上游模塊繼續發送數據。 2、存在加速比的流水反壓機制路徑延時 當上遊帶寬大於下游帶寬時,我們稱之爲存在加速比,即數據出口帶寬小,
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