【verilog】九、UDP

時間 2021-07-13

標籤 verilog 简体版

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-UDP：用戶自定義原語（User-defined Primitive），自成體系，UDP中不能調用其他原語或模塊。 UDP有兩種類型： 1、表示組合邏輯的UDP：輸出僅取決於輸入信號的組合邏輯； 2、表示時序邏輯的UDP：下一個輸出值不但取決於當前的輸入值，還取決於當前的內部狀態。輸出端口必須被聲明爲reg類型。電平敏感的狀態表輸入項，優先級高於邊沿敏感的狀態表輸入項； -組成：關鍵字

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