作業2：用Verilog語言實現二十進制計數器
1.新建一個工程，並且加入一個Verilog-HDL文件，參考例程中的代碼編寫Verilog語言，編寫完成後如下圖所示 編譯後，查看RTL文件如下圖所示 建立VWF文件，添加仿真信號後觀察仿真結果如下圖
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