Stratix IV內嵌DPA電路的基本結構
StratixIV內嵌DPA電路的基本結構 Altera DPA電路特點如下。 可以放鬆高速接口對時鐘到數據通道和數據通道之間對Skew的嚴格要求。 最高支持1.6Gbit/s應用。 專用硬件DPA 電路實現連續採樣、時鐘對齊等功能。 CDR爲可選功能。 AlteraStratix II DPA電路的性能指標 版權所有權歸卿萃科技 杭州FPGA事業部，轉載請註明出處 作者：杭州卿萃科技ALIF
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