DDR3/4_IP核應用--vivado
參考資料 《pg150-ultrascale-memory-ip》 以該手冊的脈絡爲主線，對DDR3/4控制器進行探討。 1.IP核結構 根據官方提供的資料，IP核主要劃分爲三個部分，分別是用戶接口，內存控制器以及物理層接口。對於用戶來說，我們需要研究清楚的是用戶接口部分內容，其餘兩部分只需瞭解即可，這裏就不展開論述。 讀寫效率 X8是表示，該內存顆粒的數據總線爲8bit。
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