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verilog寫的三分頻
時間 2020-08-08
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寫的
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3分
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筆試的時候有一道題目要求設計三分頻電路,暈,想了半天想不出來,回到宿舍裏才動手寫了出來,以下:設計 其實3分頻電路有不少種方法,這裏選用其中一種:先求出兩個佔空比爲1/3的頻率波形,注意分別爲上升沿觸發和降低沿觸發,最後兩個信號波形進行或運算,代碼以下:3d module san( input clk, input rst, output clk_3 );blog reg [1:0]cnt;
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