靜態時序分析
tclk：時鐘的最小週期 tcq：寄存器固有的時鐘輸出延時 tlogic：同步元件之間的組合邏輯延遲 tnet：網線的延遲 tsu：寄存器固有的時鐘建立時間 thold：寄存器的保持時間 在建立時間和保持時間都滿足的情況下，輸入端D處的數據在最壞的傳播延時之後被賦值到輸出端q tclk = tcq +tlogic +tnet + tsu togic +tnet >=thold 1、時鐘扭曲（clo
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