基於FPGA PLL鎖相環實現及示波器波形失真分析

在看前，建議先看【Cyclone_IV_器件中的時鐘網絡與 PLL.pdf 】 PLL具有時鐘倍頻和分頻、相位偏移、可編程佔空比、外部時鐘輸出，進行系統級的時鐘管理和偏移控制功能。 PLL常用於同步內部器件時鐘和外部時鐘，使內部工作的時鐘頻率比外部時鐘頻率更高，時鐘延遲和時鐘偏移最小，減小或調整時鐘到輸出和建立時間。 時鐘控制模塊輸入 輸入 說明 專用時鐘輸入 專用時鐘輸入管腳能夠驅動時鐘或者全局

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