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數字頻率計設計
時間 2020-12-30
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FPGA
板塊26:信號發生器
數字頻率計
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設計任務與要求 1、設計任務 設計並實現一個數字頻率計。 2、基本要求: 測頻率範圍:10Hz ~ 10K Hz。爲保證測量精度分爲三個頻段: 10Hz ~ 100 Hz 100Hz ~ 1K Hz 1 K Hz ~ 10K Hz 當信號頻率超過規定的頻段上限時,設有超量程指示。三個頻段之間用手動切換。 輸入波形:低頻函數信號發生器輸出的方波,幅度爲5V 。
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