三種方法用Verilog實現多人表決器

module biaojue( a,b,c,d,e,f); input a,b,c,d,e; output f; reg f; reg[2:0] count1; initial count1=0; always@(a,b,c,d,e) begin count1=a+b+c+d+e; f=count1<3?0:1;//當人數在三人如下是輸出1 end endmodule module biaojue

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