FPGA的學習：數碼管靜態顯示的實現（一）
六位八段數碼管 實現000000~FFFFFF的顯示，每一個時間間隔爲0.5s。 首先繪製三個局部的模塊。 接着繪製總體的頂層模塊。 而後畫出波形圖。 根據時序圖編寫程序。web `timescale 1ns/1ns
module seg_static
(
input wire sys_clk , //系統時鐘，頻率50MHz
input
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