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FPGA筆記記錄

2021-07-13 FPGA

Modelsim和Vcs+Verdi使用技巧(Linux)

2021-07-13 FPGA 仿真 Linux

基於FPGA的貪吃蛇遊戲設計（1）整體架構設計

2021-07-13 貪吃蛇 fpga 遊戲

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2021-07-13 verilog xilinx FPGA fifo ip core

基於C66x平臺DSP與FPGA通信測試

2021-07-13 TMS320C66x DSP C66x FPGA 通訊測試 C&C++

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Quartus II 13.1 調用NCO IP核無法生成終於搞定了

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以JESD204B subclass1來討論時鐘的時序需要以及TI時鐘芯片方案的實現

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fpga源同步輸入時序約束（二）

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每日一句

每一个你不满意的现在，都有一个你没有努力的曾经。