FPGA學習之異步FIFO
主要是參考這篇博客linkl,從頭至尾作了一遍，對部分代碼不懂的地方作了註釋html 1 FIFO是什麼 FIFO（first in first out）本質上就是個RAM，能夠用做數據緩存，解決數據發送模塊和接收模塊速度不一致的問題。web 2 FIFO設計注意事項 2.1 讀空和寫滿信號如何產生？ 讀空信號：讀地址和寫地址相等 寫滿信號：讀地址和寫地址相等，可是讀地址會比寫地址落後一個週期數組
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