組合電路中的競爭與冒險

組合電路中的競爭與冒險 1.競爭與冒險 由於邏輯門存在延遲時間以及信號的傳輸路徑不同，當輸人信號電平發生瞬間變化時，電路可能產生與穩態時邏輯功能不一致的錯誤輸出，這種現象就是電路中的競爭與冒險。 例如，一個簡單組合電路如下圖所示，若不考慮門的延遲時間，則有F=A・(~A)=0，穩態時F應恆爲0。若考慮門的延遲(設每個門的延遲均爲t)，則輸入信號A需經非門延退t後オ得到A非。當A変量發生跳變(0→1

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