lockup latch & clock gating cell

時間 2021-01-04

標籤 DFT_Stand cell Scan 筆記简体版

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Latch功能 Latch的電路結構如下圖： Latch電路結構當 E = 1 時，latch直傳（transparent），D端信號的變化會即時反應在Q端；當 E = 0 時，latch關斷（closed），Q端保持關斷瞬間D端的值。設計中使用Latch的好處是，相比寄存器的面積更小，功耗更低，可以從後級電路進行time borrowing，更容易滿足setup time，然而壞處是STA

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1. Clock Gating cell 與 Integrated Clock Gating cell(ICG)
2. clock Gating
3. clock gating門控時鐘
4. Clock Gating Checks
5. clock gating 和 power gating的區別
6. 時鐘門控技術(Clock Gating)
7. LVL (Level shift cell) power gating /power switch / Isolation
8. soft lockup和hard lockup介紹
9. 靜態時序分析——Clocl Gating check
10. OCC(On-Chip-Clock)含義及功能
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