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QUARTUS15.0和MODELSIM聯合仿真
時間 2021-01-09
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FPGA
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建立工程項目 建立VHDL文件 在左邊導航欄FILES中對應看到vhd後綴的文件H:\FPGA\EDA\eda_01\halfadder.vhd; 也可以開始在文本中進行編輯,也可以在本地創建記事本後寫入保存後修改後綴爲vhd格式,通過導航欄ADD/REMOVE FILES IN PROJECT加入文件 文件導入後進行編譯 COMPILE,如果不出現報錯信息說明不存在語法錯誤以及文件目錄創建等其他
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