Verilog學習筆記之蜂鳴器（按鍵消抖）

always @(posedge sys_clk or negedge sys_rst_n) begin if (!sys_rst_n) begin //系統復位時，給兩個寄存器賦值 key_reg <= 1'b1; delay_cnt <= 32'd0; end else begin key_reg <= key;//

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