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數字電路基礎知識(二)
時間 2019-12-06
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PS:爲了面試準備的,總結的比較粗糙。面試 1.實現D觸發器邏輯算法 //基本D觸發器dom module D_EF(Q,D,CLK)異步 input D,CLK;函數 output Q;性能 reg Q; //在always語句中被賦值的信號要聲明爲reg類型 寄存器定義spa always @ (posedge CLK).net
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