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FPGA TDC 進位鏈
時間 2021-01-18
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CYCLONE IV的LE結構圖: 可以看到裏面有一個4輸入的LUT,有一個3輸入的LUT。 LE有兩種模式,如果是普通模式,就只用到那個4輸入的LUT,用來實現4輸入的組合邏輯功能。 如果是算術模式,就是用來實現加法運算。這個時間一般DATA D輸入爲VCC或其他,反正不用。 DATA C選擇使用CIN。4輸入的LUT就用來實現DATA,DATAB,CIN的加法運算。3輸入的LUT用來
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