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fpga 如何用VIO
時間 2021-01-13
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在硬件調試過程中,經常會遇到這種情況。我們需要抓的時序可能剛上電的時候就有,等我們開始抓取波形的時候,該時序已經不能正常獲取了。這就需要我們添加一個VIO ,下載完代碼以後,觸發VIO 產生一個使能信號,用該使能信號做邏輯觸發,抓取時序波形。 將上述IP核生成好,添加到代碼中。測試的時候,輸出默認是0,運行VIO 以後輸出1 。用1 做觸發,做邏輯的使能信號。 vio_
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