verilog 時鐘無縫切換電路

電路   基本原理是依靠兩級緩衝完成時鐘的切換   上圖就是時鐘無縫切換的一種電路圖，通過兩級dff級聯加上反饋電路形成，分析它的工作過程，可以看到，當select由0→1時，     Q1在下圖的clk0的這一時刻，會有1→0   緊接着 Q2在下圖的clk0的這一時刻，會有1→0 所以Q2N就有0→1     在這之後，同樣在clk1的這兩個時刻，它的觸發器會有變化，從0→1，   所以，在這

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