Quartus Ⅱ調用modelsim仿真時報錯及解決方法（verilog）
1.測試 # ** Error: (vsim-3170) Could not find 'C:/Users/acer/Desktop/processor/simulation/modelsim/rtl_work.prco_tb'.spa # # Error loading designio 錯誤緣由：Quartus中assigments>settings>simulation中的testbench
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