SERDES高速系統(一)

在目前主流廠商的高端FPGA 中都集成了SERDES（串並收發單元）硬核，如Altera的Stratix IV GX器件族內部集成的SERDES單通道支持600Mbit/s到8.5Gbit/s數據熟率，而Stratix IV系列器件族還集成支持150Mbit/s到1.6Mbit/s的高速差分信號接口，並增強了其動態相位調整（DPA,Dynamic Phase Alignment）特性；Xilinx

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