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異步復位、同步釋放
時間 2020-07-24
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FPGA設計中常見的復位方式即同步復位和異步復位。在深刻探討亞穩態這個概念以前,特權同窗也並無對所謂的同步復位和異步復位有太多的注意,而在實踐中充分感覺了亞穩態的危害以後,回過頭來細細品味《Verilog HDL設計與驗證》一書中關於復位的章節,可謂受益不淺。html 在特權同窗之前的代碼裏大多使用的是異步復位。異步 一個簡單的異步復位的例子post always
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