如何生成HDL例化模板？

參考資料： https://forums.xilinx.com/t5/Design-Entry/In-vivado-how-to-generate-instantiation-template/td-p/471962 《Xilinx FPGA 權威設計指南：基於Vivado 2018集成開發環境》/何賓編著 P87 在傳統的ISE開發環境中，提供了從用戶自己設計的Verilog HDL代碼中生成H

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