如何閱讀 Vivado中的Timing Report
《XDC約束技巧》系列中討論了XDC約束的設置方法、約束思路和一些容易混淆的地方。咱們提到過 約束是爲了設計服務，寫入Vivado中的XDC實際上就是用戶設定的目標 ，Vivado對FPGA設計的實現過程必須以知足XDC中的約束爲目標來進行。那麼：正則表達式 如何驗證明現後的設計有沒有知足時序要求？如何在開始佈局佈線前判斷某些約束有沒有成功設置？如何驗證約束的優先級？ 這些都須要用到Vivado中
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