Verilog學習（二）Verilog模型
主要有五種模型： 1) 系統級(system) 2) 算法級(algorithmic) 3) RTL級(RegisterTransferLevel): 4) 門級(gate-level): 5) 開關級(switch-level) 其中門類型有： 用戶定義的原語（UDP） 注意點： 1) UDP只能有一個輸出端，而且必定是端口說明列表的第一項。 2) UDP可以有多個輸入端，最多允許有10個輸入端
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