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HDL class 2(利用case語句,並調用子模塊)
時間 2021-01-03
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vhdl
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完成下圖所示圖形: 邏輯功能描述 control 模塊接收到tx_done信號之後給send模塊發出en使能信號和8位data。 send 模塊當en使能爲高的時候,開始將輸入的數據一位一位的傳輸給tx(output), 當八位數據輸出完成之後tx_done=1; tx_done之後延時50 ms 寫一個top level來調用control 和send 模塊 注意 如果control不發en信號
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