verilog求助
想求助一下各位大神，我想把key_value[3:0]作爲led_value[7:0]的高四位和第四位，並將其連在一起做出頂層原理圖。圖上方式在仿真中跑出來高四位還是高阻態沒有輸入值。 所用軟件:quartus10.1
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