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基於matlab FPGA verilog的FIR濾波器設計
時間 2020-12-30
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大俠好,歡迎來到FPGA技術江湖,江湖偌大,相見即是緣分。大俠可以關注FPGA技術江湖,在「闖蕩江湖」、"行俠仗義"欄裏獲取其他感興趣的資源,或者一起煮酒言歡。 今天和大俠簡單聊一聊基於matlab FPGA verilog的FIR濾波器設計,話不多說,上貨。 本次設計實現8階濾波器,9個係數,由於係數的對稱性,h(0)=h(8),h1(1)=h(7),h(2)=h(6),h(3)=h(5),h
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