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運放 - 輸出阻抗(Open loop output resistance)Ro
時間 2021-01-13
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令人吃驚的模擬電路
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我們知道運放的特點都是高輸入阻抗,低輸出阻抗;而假設的理想運放更是將輸入阻抗近似到無窮大,輸出阻抗趨近於零;高輸入阻抗是爲是減小對前級的影響,而低輸出阻抗帶負載能力強,所以在小信號放大電路中我們總是在前級設計一個跟隨電路,提高電路的性能。 然而運放並不是理想運放,所以每個datasheet會列出它在極限條件下參數值供我們參考,在datasheet中有一個參數:開環輸
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