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Vivado時序收斂技術(二) 時序違例的根本原因及解決方法
時間 2021-01-09
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FPGA
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時序收斂
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本文整理自Xilinx公開課:Vivado時序收斂技術。 有些知識在公開課中講的並不是很細,因此我又對齊進行了整理,分爲了幾篇文章。 有很多內容也在我的時序約束課程中講到過,都是免費課程,大家可以在我的知乎專欄上找到。 FPGA Times 如果出現了時序違例,我們會關注兩點: 爲什麼會出現時序違例? 如何解決? 首先我們要搞清楚時序是在哪個階段違例: 在綜合階段或者post opt階段出現了時序
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