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ISE設計->(Gray與Binary的轉換)
時間 2021-07-11
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格雷碼
FPGA
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異步
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現代的數字設計中,考慮到實際應用要求,模塊的時鐘可能頻率並不相同,跨時鐘域這個比較令人痛疼的問題便油然而生了。爲了滿足建立時間和保持時間的要求,一種解決異步時鐘域數據傳送的時序違例方法出現了,採用FIFO來進行異步數據傳送。 FIFO中讀寫指針遞增電路設計很重要,常規的利用二進制計數器的方法實現指針的遞增會產生時序的違例。簡單分析,若計數器從ff到00改變,時鐘邊沿在數據轉換的中間時間區域內來到,
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