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HLS(High-Level Synthesis)詳解——循環體並行優化
時間 2021-01-05
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虹科FPGA-HLS
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HLS高級綜合能夠實現軟體代碼的硬件加速,主要是因爲其對代碼中的循環體(for,while)等進行了並行性優化,採用流水,展開,合併,嵌套,數據流等方法,將軟體中需要一步步執行的循環體,在硬件電路中實現並行化處理,從而大幅提高計算速度,正好應對當下這種高計算量的需求。 本博客講解一下循環體優化的一些方法,以及一些特殊循環體的優化(嵌套for循環,變量邊界循環體),參考b站賽靈思官方HLS介紹視頻。
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