【ZYNQ-7000 開發之七】PL讀寫DDR3

時間 2020-12-29

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0.引言構建SoC系統，畢竟是需要實現PS和PL間的數據交互，而像上一講那樣PL主機與PL從機之間通過AXI4-Lite總線進行交互有點殺雞用牛刀了。如果PS與PL端進行數據交互，可以直接設計PL端爲從機，PS端向PL端的reg寫入數據即可，但是對於圖像處理等大數據量的數據交互來說，PL端的BRAM畢竟容量有限，很難用BRAM作爲兩者間的數據緩存器。對於這樣的應用來說，利用DDR3作爲PS端與

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