vivado xdc約束基礎知識16：vivado時序約束設置嚮導中參數配置二（FPGA靜態時序分析模型——寄存器到寄存器）
來自：https://www.cnblogs.com/linjie-swust/archive/2012/01/11/2318716.html 以下內容爲STA所需的基本知識，需要反覆理解才能吸收，慚愧的是，我已經理解很多次啦， 每一次再看到，都感覺有一點生疏，做流程的同學，可能接觸更多，理解更好吧。 1. 適用範圍 本文檔理論適用於Actel FPGA並且採用Libero軟件進行靜態
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