S3C2440芯片時鐘配置
S3C2440A芯片中的時鐘控制邏輯可以生成所需的時鐘信號，包括用於CPU的FCLK、AHB (Advanced High-performance Bus) 總線外圍設備的HCLK，以及APB (Advanced Peripheral Bus)總線外圍設備的PCLK。S3C2440A有兩個相鎖循環（PLLs）：一個用於FCLK、HCLK和PCLK，另一個用於USB塊（48 Mhz）
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