異步FIFO設計

需求說明：Verilog設計 內容       ：異步FIFO設計 來自       ：時間的詩 原文：http://www.cnblogs.com/BitArt/archive/2013/04/10/3010073.html 本文大部分內容來自Clifford E. Cummings的《Simulation and Synthesis Techniques for Asynchronous FI

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