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異步FIFO(一)——FIFO的理論基礎
時間 2021-01-03
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數字電路設計
Verilog HDL
verilog
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本文爲學習筆記,主要參考《VerilogHDL高級數字設計》,Clifford的論文Simulation and Synthesis Techniques for Asynchronous FIFO Design以及張波的碩士論文:基於SOC異步FIFO的設計與形式驗證 FIFO簡介 FIFO爲First in first out 的縮寫,是一種先進先出存儲器,通常用於接口電路的數據緩存,跨時鐘域
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